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共搜索到84 篇文章
2005-10-21 汽车远程信息处理和信息娱乐系统的即时启动技术
  引言:QNX软件系统公司开发出的被称为“迷你驱动程序(mini-driver)技术”的即时启动技术,可满足汽车远程信息处理和信息娱乐系统的启动时序要求。
2005-08-01 IBM率先开发出商业化增量统计时序分析工具
  IBM公司最近声称,它已开发出业内首款商业化增量统计时序分析工具EinTimer。
2005-08-01 新思“拓扑”工具改善布局后时序和面积
  新思科技公司最近推出一种“拓扑”技术,据称该技术可使得Design Compiler 2005逻辑综合工具无需使用线载模型。
2005-07-26 Incentia推出90nm节点时序和综合工具
  Incentia Design Systems公司日前宣布推出针对90纳米设计而优化的新版本时序和综合工具。
2005-06-13 卓联半导体开发出时序分组技术
  卓联半导体(Zarlink Semiconductor)公司已经开发出一种时序分组(timing-over-packet, ToP)技术,使电信运营商能够在分组网络上支持对时间严格要求的语音、视频和数据服务。
2005-06-07 分层设计纳入时序分析工具,不再依赖抽象模型创建
  Manhattan Routing Inc.(MRI)最近扩展了其Physical Window/Optimization Cockpit时序收敛工具的功能,将分层(hierarchical)集成电路(IC)设计优化功能纳入其中。
2005-04-12 安捷伦为串行协议测试仪新增PCI Express测试功能
  安捷伦科技(Agilent Technologies)公司日前为其E2960A系列串行协议测试仪器添加了多项新功能,这些增强型解决方案可对PCI Express和光纤信道半导体与系统进行时序连接(time-correlated)的跨域(cross-domain)协议分析。
2005-03-21 如何保证RTL设计与综合后网表的一致性
  在超大规模数字集成电路的设计中,我们使用逻辑综合工具来完成从RTL设计到门级网表的转化。我们希望它综合出的门级网表与我们的RTL设计在逻辑和时序上完全一致。但是某些书写风格和设计思路却会造成两者不一致的情况,降低我们的工作效率。本文列举了三种RTL设计与综合后网表不一致的情况,并给出了解决方法。我们以Design Compiler为例,来说明设计RTL时应该注意的问题。在仿真和调试时,我们使用了NC-Verilog和Debussy。
2005-03-18 软件时序异常校验器问世,可验证错误路径
  Real Intent公司最近在德国举行的欧洲设计自动化与测试(DATE)会议上推出一种软件时序异常校验器(timing-exception prover)??PureTime,能验证错误和多周期路径,据称能帮助设计师大幅节省手工评估的时间。
2005-02-08 Synopsys CEO放言:IC设计需要系统化解决方案
  Synopsys公司CEO Aart de Geus日前在DesignCon大会的主题演讲上表示,芯片设计师需要停止孤立地看待问题,而应该发现“系统化”的解决方案,以解决相互影响的功率、时序、面积和良品率。
2005-02-03 Cadence发布设计约束检查工具
  Cadence Design System公司发布新款形式分析工具,可生成、分析并验证设计者在运行综合工具、时序分析工具和布局布线工具时使用的设计约束的质量。
2004-09-02 基于PXA27x处理器的智能手机LCD驱动电路设计
  液晶屏设计的好坏直接关系到智能手机的整体性能表现,然而液晶显示屏种类繁多,工程师需要针对各种显示屏的时序匹配、电源要求以及控制器的不同特点进行设计。
2004-07-11 平台ASIC架构突破传统ASIC设计局限性
  采用先进半导体工艺,结构化ASIC平台可以提供更多经预定义、预验证和预扩散的金属层,并支持各种存储器接口,能简化接口设计和时序问题。
2004-06-30 相位噪声和抖动的概念及其估算方法
  时钟频率的不断提高使相位噪声和抖动在系统时序上占据日益重要的位置。
2003-08-09 克服SoC设计中存储器的时序和功耗瓶颈
  引言:



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